Virtuosity：在Virtuoso中引入Automated Device Placement and Routing

30 Oct 2019 • 1 minute read

半导体行业长期以来一直依赖用于IC设计的electronic design automation（EDA）软件。随着行业多年来的发展，EDA工具也在不断发展。

然而，analog和full custom的EDA工具的发展并不像digital方面那样引人注目。这背后有几个原因，最重要的是通过自动化生成layout的难度与手动制作的质量相匹配。此外，analog designs通常基于较旧的工艺节点，因为它们缺乏移动到较新nodes的digital designs的强大动机（功率，性能，面积和成本)。

近年来，由移动技术和物联网等驱动因素推动的芯片（SoC）analog和mixed signal（A / MS）systems的显著增长是游戏规则的改变者。Analog和mixed signal circuits不再能以相同的速度设计。较新nodes的复杂性迫使这些设计遵循结构化布局方法，类似于其digital对应物，以及对自动化的日益增长的需求。然而，分组和匹配的固有analog layout要求仍然存在，使其成为一项独特的挑战。

作为模拟和全定制设计解决方案无可争议的行业领导者，Virtuoso®技术不可避免的问题不是“如果”，而是“何时”它将为最终用户提供这样的自动化功能。

就是现在！

ICADVM18.1通过推出面向advanced nodes的Fully Automated Device-Level Placement and Routing Solution，并与代表性工艺厂商的行业领导者合作开发，更加引人注目。该解决方案通过一个assistant-driven flow，自动执行每个步骤，从constraint创建和网grid生成到placement，fill插入和routing - 在几分钟内生成layout，只有原理图作为输入。因此，该解决方案可用于快速生成多个布局以进行extraction和re-simulation，从而在早期为电路设计人员提供有价值的反馈，并消除代价高昂的迭代。此外，它还可以为布局设计人员提供一个可靠的起点，可以逐步完善并快速完成。

下一步是什么？

在本系列的即将发布的帖子中，我们将介绍此流程的每个步骤：

自动device分组和constraint创建
自动生成grid，用于placement和routing
具有不同aspect ratios的自动 device placement
自动base layer fill插入
自动tree-style device routing

我们期待着带您进入模拟布局自动化世界的这一激动人心的旅程。每隔一周留意我们的帖子！

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阅读快乐!

- Sravasti Nair

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